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之前完成了功能仿真#xff0c;下面我们进行综合实现。
10.1.1 综合 综合成功。
实现试试 这真是令人悲伤……找Bug吧。
我们看看综合后的门级网表。
发现综合后的并不是我们想要的……看了看可能是综合的目录错误#xff0c;我们再试试。
不是这…接上一篇文章的第10节
之前完成了功能仿真下面我们进行综合实现。
10.1.1 综合 综合成功。
实现试试 这真是令人悲伤……找Bug吧。
我们看看综合后的门级网表。
发现综合后的并不是我们想要的……看了看可能是综合的目录错误我们再试试。
不是这个原因……
单元测试每一个模块综合都没问题为啥连起来就不行了?
可能因为没有输出
我们先把之前的寄存器堆初始化该回去默认全0.
再让ALUresult暂时作为输出试试。
没有输出的模块是没用的也可能是把synthesis搞傻的原因…… 就像是算法要求至少一个输出没用输出的话没得玩了。我们改改试试。
比之前好一些但是还是有问题没有控制器……
不知道为啥……
10.1.2 实现
继续进行先实现试试看。 居然成功了就是不知道对不对之后还得实现验证也没准可能synthesis的时候将控制器弄没了不得而知……
关于实现这些我们后面再说。
小结
行为仿真正确后进行综合之后要查看相关报告看看对不对没问题之后再进行实现再查看对不对最后再下载实现验证。
既然每个单元都可以综合那就是顶层文件设计有问题去哪里找找。 进一步测试
之后发现综合之后不是实现而应该进行综合仿真。
综合后功能仿真综合后时序仿真
然后发现虽然控制器消失了但是没什么问题结果依然正确
功能仿真与之前的结果一样时序仿真有些不同
注意点
综合的是top设计文件仿真的是top仿真文件
需要更改顶层文件可以右键单击然后点set as top 最后时序仿真有什么问题呢 出现了很多诡异的点可能是毛刺也可能是变化不同步…… 以后再解决吧目前知识水平达不到这个地步先放放
实现之后管脚分配还有下载验证……以后再说。
目前来说这些可能的毛刺不影响结果但是会影响主频提升那就是高端操作了现在不合时宜。
